Environnement de conception pour FPGA

Le 15/04/2004 à 7:00 par La rédaction
Libero 5.2 d’Actel Ce flot de conception intégré estdestiné aux FPGA ProAsic Plus d’Actel. Outil de test et de programmation d’une chaîne de FPGA, de circuits spécifiques ou de microcontrôleurs (Chain Builder) avec création d’un fichier STAPL Fenêtre de gestion interactive des projets Amélioration des algorithmes de routage Outil Palace de Magma pour la synthèse…
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